kopia lustrzana https://github.com/micropython/micropython
5.0 KiB
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1 | Port | Pin | AF0 | AF1 | AF2 | AF3 | AF4 | AF5 | AF6 | AF7 | |||||||||
---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|
2 | AF0 | AF1 | AF2 | AF3 | AF4 | AF5 | AF6 | AF7 | ADC | ||||||||||
3 | PortA | PA0 | USART2_CTS | TIM2_CH1_ETR | TSC_G1_IO1 | USART4_TX | COMP1_OUT | ADC1_IN0 | |||||||||||
4 | PortA | PA1 | EVENTOUT | USART2_RTS | TIM2_CH2 | TSC_G1_IO2 | USART4_RX | TIM15_CH1N | ADC1_IN1 | ||||||||||
5 | PortA | PA2 | TIM15_CH1 | USART2_TX | TIM2_CH3 | TSC_G1_IO3 | COMP2_OUT | ADC1_IN2 | |||||||||||
6 | PortA | PA3 | TIM15_CH2 | USART2_RX | TIM2_CH4 | TSC_G1_IO4 | ADC1_IN3 | ||||||||||||
7 | PortA | PA4 | SPI1_NSS/I2S1_WS | USART2_CK | TSC_G2_IO1 | TIM14_CH1 | USART6_TX | ADC1_IN4 | |||||||||||
8 | PortA | PA5 | SPI1_SCK/I2S1_CK | CEC | TIM2_CH1_ETR | TSC_G2_IO2 | USART6_RX | ADC1_IN5 | |||||||||||
9 | PortA | PA6 | SPI1_MISO/I2S1_MCK | TIM3_CH1 | TIM1_BKIN | TSC_G2_IO3 | USART3_CTS | TIM16_CH1 | EVENTOUT | COMP1_OUT | ADC1_IN6 | ||||||||
10 | PortA | PA7 | SPI1_MOSI/I2S1_SD | TIM3_CH2 | TIM1_CH1N | TSC_G2_IO4 | TIM14_CH1 | TIM17_CH1 | EVENTOUT | COMP2_OUT | ADC1_IN7 | ||||||||
11 | PortA | PA8 | MCO | USART1_CK | TIM1_CH1 | EVENTOUT | CRS_SYNC | ||||||||||||
12 | PortA | PA9 | TIM15_BKIN | USART1_TX | TIM1_CH2 | TSC_G4_IO1 | I2C1_SCL | MCO | |||||||||||
13 | PortA | PA10 | TIM17_BKIN | USART1_RX | TIM1_CH3 | TSC_G4_IO2 | I2C1_SDA | ||||||||||||
14 | PortA | PA11 | EVENTOUT | USART1_CTS | TIM1_CH4 | TSC_G4_IO3 | CAN1_RX | I2C2_SCL | COMP1_OUT | ||||||||||
15 | PortA | PA12 | EVENTOUT | USART1_RTS | TIM1_ETR | TSC_G4_IO4 | CAN1_TX | I2C2_SDA | COMP2_OUT | ||||||||||
16 | PortA | PA13 | SWDIO | IR_OUT | |||||||||||||||
17 | PortA | PA14 | SWCLK | USART2_TX | |||||||||||||||
18 | PortA | PA15 | SPI1_NSS/I2S1_WS | USART2_RX | TIM2_CH1_ETR | EVENTOUT | USART4_RTS | ||||||||||||
19 | PortB | PB0 | EVENTOUT | TIM3_CH3 | TIM1_CH2N | TSC_G3_IO2 | USART3_CK | ADC1_IN8 | |||||||||||
20 | PortB | PB1 | TIM14_CH1 | TIM3_CH4 | TIM1_CH3N | TSC_G3_IO3 | USART3_RTS | ADC1_IN9 | |||||||||||
21 | PortC | PC0 | EVENTOUT | USART7_TX | USART6_TX | ADC1_IN10 | |||||||||||||
22 | PortC | PC1 | EVENTOUT | USART7_RX | USART6_RX | ADC1_IN11 | |||||||||||||
23 | PortC | PC2 | EVENTOUT | SPI2_MISO/I2S2_MCK | USART8_TX | ADC1_IN12 | |||||||||||||
24 | PortC | PC3 | EVENTOUT | SPI2_MOSI/I2S2_SD | USART8_RX | ADC1_IN13 | |||||||||||||
25 | PortC | PC4 | EVENTOUT | USART3_TX | ADC1_IN14 | ||||||||||||||
26 | PortC | PC5 | TSC_G3_IO1 | USART3_RX | ADC1_IN15 | ||||||||||||||
27 | PortC | PC6 | TIM3_CH1 | USART7_TX | |||||||||||||||
28 | PortC | PC7 | TIM3_CH2 | USART7_RX | |||||||||||||||
29 | PortC | PC8 | TIM3_CH3 | USART8_TX | |||||||||||||||
30 | PortC | PC9 | TIM3_CH4 | USART8_RX | |||||||||||||||
31 | PortC | PC10 | USART4_TX | USART3_TX | |||||||||||||||
32 | PortC | PC11 | USART4_RX | USART3_RX | |||||||||||||||
33 | PortC | PC12 | USART4_CK | USART3_CK | USART5_TX | ||||||||||||||
34 | PortC | PC13 | |||||||||||||||||
35 | PortC | PC14 | |||||||||||||||||
36 | PortC | PC15 | |||||||||||||||||
37 | PortD | PD0 | CAN1_RX | SPI2_NSS/I2S2_WS | |||||||||||||||
38 | PortD | PD1 | CAN1_TX | SPI2_SCK/I2S2_CK | |||||||||||||||
39 | PortD | PD2 | TIM3_ETR | USART3_RTS | USART5_RX | ||||||||||||||
40 | PortD | PD3 | USART2_CTS | SPI2_MISO/I2S2_MCK | |||||||||||||||
41 | PortD | PD4 | USART2_RTS | SPI2_MOSI/I2S2_SD | |||||||||||||||
42 | PortD | PD5 | USART2_TX | ||||||||||||||||
43 | PortD | PD6 | USART2_RX | ||||||||||||||||
44 | PortD | PD7 | USART2_CK | ||||||||||||||||
45 | PortD | PD8 | USART3_TX | ||||||||||||||||
46 | PortD | PD9 | USART3_RX | ||||||||||||||||
47 | PortD | PD10 | USART3_CK | ||||||||||||||||
48 | PortD | PD11 | USART3_CTS | ||||||||||||||||
49 | PortD | PD12 | USART3_RTS | TSC_G8_IO1 | USART8_CK_RTS | ||||||||||||||
50 | PortD | PD13 | USART8_TX | TSC_G8_IO2 | |||||||||||||||
51 | PortD | PD14 | USART8_RX | TSC_G8_IO3 | |||||||||||||||
52 | PortD | PD15 | CRS_SYNC | TSC_G8_IO4 | USART7_CK_RTS | ||||||||||||||
53 | PortE | PE0 | TIM16_CH1 | EVENTOUT | |||||||||||||||
54 | PortE | PE1 | TIM17_CH1 | EVENTOUT | |||||||||||||||
55 | PortE | PE2 | TIM3_ETR | TSC_G7_IO1 | |||||||||||||||
56 | PortE | PE3 | TIM3_CH1 | TSC_G7_IO2 | |||||||||||||||
57 | PortE | PE4 | TIM3_CH2 | TSC_G7_IO3 | |||||||||||||||
58 | PortE | PE5 | TIM3_CH3 | TSC_G7_IO4 | |||||||||||||||
59 | PortE | PE6 | TIM3_CH4 | ||||||||||||||||
60 | PortE | PE7 | TIM1_ETR | USART5_CK_RTS | |||||||||||||||
61 | PortE | PE8 | TIM1_CH1N | USART4_TX | |||||||||||||||
62 | PortE | PE9 | TIM1_CH1 | USART4_RX | |||||||||||||||
63 | PortE | PE10 | TIM1_CH2N | USART5_TX | |||||||||||||||
64 | PortE | PE11 | TIM1_CH2 | USART5_RX | |||||||||||||||
65 | PortE | PE12 | TIM1_CH3N | SPI1_NSS/I2S1_WS | |||||||||||||||
66 | PortE | PE13 | TIM1_CH3 | SPI1_SCK/I2S1_CK | |||||||||||||||
67 | PortE | PE14 | TIM1_CH4 | SPI1_MISO/I2S1_MCK | |||||||||||||||
68 | PortE | PE15 | TIM1_BKIN | SPI1_MOSI/I2S1_SD | |||||||||||||||
69 | PortF | PF0 | CRS_SYNC | I2C1_SDA | |||||||||||||||
70 | PortF | PF1 | I2C1_SCL | ||||||||||||||||
71 | PortF | PF2 | EVENTOUT | USART7_TX | USART7_CK_RTS | ||||||||||||||
72 | PortF | PF3 | EVENTOUT | USART7_RX | USART6_CK_RTS | ||||||||||||||
73 | PortF | PF6 | |||||||||||||||||
74 | PortF | PF9 | TIM15_CH1 | USART6_TX | |||||||||||||||
75 | PortF | PF10 | TIM15_CH2 | USART6_RX |